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【填空题】

Verilog HDL的变量分为（）和（）两种。

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更多“Verilog HDL的变量分为（）和（）两种。”相关的问题

第1题

[填空题] 在Verilog HDL的阻塞赋值语句中，赋值号”=”左边的赋值变量必须是（）型变量。

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第2题

[] 在Verilog HDL的非阻塞赋值语句中，赋值号是（），赋值变量必须是（）型变量。

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第3题

[填空题] 在Verilog HDL中register型变量有（）、（）、（）和（）4种。

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第4题

[填空题] Verilog HDL的模块Verilog HDL模块的T/O声明用来声明模块端口定义中各端口数据流动方向，包括（）、（）和（）。

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第5题

[单选题] 在Verilog HDL的设计模块中，最常用的寄存器型变量是（）型变量。

A、reg B、nets C、reg或nets D、integer

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第6题

[填空题] Verilog HDL的register型变量是一种数值容器，不仅可以容纳（），也可以保持（），这一属性与触发器或寄存器的记忆功能有很好的对应关系。

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第7题

[单选题] 在Verilog HDL模块中，task语句类似高级语言中的（）。

A、函数 B、常数 C、变量 D、子程序

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第8题

[] 主要的HDL语言是哪两种？Verilog HDL语言的特点是什么？

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第9题

[单选题] 在Verilog HDL中，连续赋值语句的“=”号两边的变量都应该是（）。

A、wire B、register C、wire或register D、integer

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