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【填空题】

Verilog HDL的功能描述是用来描述设计模块的（）和模块端口间的（）。

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第1题

[] Verilog HDL的功能描述是用来描述设计模块的内部结构和模块端口间的逻辑关系，通常把确定这些设计模块描述的方法称为（）。

A、A.综合 B、B.仿真 C、C.建模 D、D.设计

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第2题

[填空题] Verilog HDL的模块Verilog HDL模块的T/O声明用来声明模块端口定义中各端口数据流动方向，包括（）、（）和（）。

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第3题

[填空题] Verilog HDL的功能描述可以用（）、（）、（）和（）等方法来实现，通常把确定这些设计模块描述的方法称为建模。

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第4题

[填空题] Verilog HDL模块分为两种类型：一种是（）模块，即，描述某种电路系统结构，功能，以综合或者提供仿真模型为设计目的；另一种是（）模块，即，为功能模块的测试提供信号源激励、输出数据监测。

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第5题

[填空题] Verilog HDL的模块端口定义用来声明电路设计模块的（）和（）。

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第6题

[单选题] 用Verilog HDL的元件例化方式建模来完成的设计一般属于（）描述方式。

A、行为 B、结构 C、功能 D、行为和结构

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第7题

[填空题] 在Verilog HDL中，行为描述包括（）、（）和（）3种抽象级别。

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第8题

[填空题] 在Verilog HDL中，结构描述包括（）和（）两种抽象级别。

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第9题

[] 主要的HDL语言是哪两种？Verilog HDL语言的特点是什么？

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