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【简答题】

8086正常的存储器读/写总线周期由多少个T状态组成？

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第1题

[简答题] 假设某存储器总线采用同步通信方式，时钟频率为50MHz时钟，每个总线事务以突发方式传输8个字，以支持块长为8个字的Cache行读和Cache行写，每字4字节。对于读操作，访问顺序是1个时钟周期接受地址，3个时钟周期等待存储器读数，8个时钟周期用于传输8个字。对于写操作，访问顺序是1个时钟周期接受地址，2个时钟周期延迟，8个时钟周期用于传输8个字，3个时钟周期恢复和写入纠错码。对于以下访问模式，求出该存储器读/写时在存储器总线上的带宽。 ①全部访问为连续的读操作； ②全部访问为连续的写操作； ③65%的访问为读操作，35%的访问为写操作。

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第2题

[单选题] ’C54x系列内部有P、C、D、E等4组总线，每组总线中都有地址总线和数据总线，以下哪项操作不是在一个机器周期内可以完成的（）。

A、向数据存储器写一个操作数 B、从数据存储器中读一个操作数 C、向数据存储器写两个操作数 D、从数据存储器中读两个操作数

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第3题

[单选题] 若8086中，当=0，=0，=1时，CPU完成的操作是（）

A、存储器写 B、I/O写 C、存储器读 D、I/O读

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第4题

[单选题] 8086CPU中，当=1，=0，=1时CPU执行的操作是（）

A、存储器读 B、I/O读 C、存储器写 D、I/O写

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第5题

[简答题] 考虑以下两种总线：总线1是64位数据和地址复用的总线。能在一个时钟周期中传输一个64位的数据或地址。任何一个读写操作总是先用一个时钟周期传送地址，然后有2个时钟周期的延迟，从第四时钟周期开始，存储器系统以每个时钟2个字的速度传送，最多传送8个字。总线2是分离的32位地址和32位数据的总线。读操作包括：一个时钟周期传送地址，2个时钟周期延迟，从第四周期开始，存储器系统以每时钟1个字的速度传输最多8个字。对于写操作，在第一个时钟周期内第一个数据字与地址一起传输，经过2个时钟周期的延迟后，以每个时钟1个字的速度最多传输7个余下的数据字。假定进行60%的读操作和40%的写操作。在以下两种情况下，求这两种总线和存储器能提供的带宽。 ①只进行单数据字的传输。 ②所有的传输都是8个字的数据块。

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第6题

[简答题] 一个典型的存储器读/写周期由几个时钟周期所组成？

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第7题

[单选题] 在8086的最小模式系统中，、和当前信号为0、1、0，表示现在进行的是（）

A、I/O读 B、I/O写 C、存储器写 D、存储器读

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第8题

[单选题] 8086/8088CPU的RD、M/IO引脚上为逻辑0时，意味着（）操作。

A、读存储器 B、写存储器 C、读I/O端口 D、写I/O端口

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第9题

[单选题] 8086工作在最小模式下，当M/IO#=0，RD#=0，WR#=1时，CPU完成的操作是（）

A、存储器读 B、I/O读 C、存储器写 D、I/O写

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