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【单选题】

构成一个全加器应由两个半加器和一个（）

A、与非门

B、与门

C、或门

D、或非门

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A、半加器 B、全加器 C、加法器 D、比较器

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A、半加器 B、全加器 C、加法器 D、比较器

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第5题

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A、编码器 B、译码器 C、全加器 D、半加器

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A、移位寄存器 B、半加器 C、全加器 D、数据选择器

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第9题

[单选题] 下列哪组不属于时序逻辑电路（）

A、主从触发器，T触发器 B、数码寄存器，移位寄存器 C、异步计数器，同步计数器 D、半加器，全加器

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