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【填空题】

在verilog HDL的always块本身是（）语句。

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第1题
[] 主要的HDL语言是哪两种？Verilog HDL语言的特点是什么？

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第2题
[填空题] 在Verilog HDL的逻辑运算中，设a=2，b=0，则a&&b结果为（）， a||b结果为（）。

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第3题
[填空题] 在Verilog HDL的逻辑运算中，设a=4´b1010，a>>1结果是（）。

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第4题
[填空题] HDL综合器就是逻辑综合的过程，把可综合的VHDL/Verilog HDL转化成硬件电路时，包含了三个过程，分别是（）、（）、（）。

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第5题
[] 在Verilog HDL的逻辑运算中，设A=4´b1010，则表达式~A的结果为（）。

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第6题
[填空题] Verilog HDL的模块Verilog HDL模块的T/O声明用来声明模块端口定义中各端口数据流动方向，包括（）、（）和（）。

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第7题
[填空题] Verilog HDL中的端口类型有三类：（）、（）、输入/输出端口。

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第8题
[] Verilog HDL中的always语句中的语句是（）语句。

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第9题
[填空题] Verilog HDL常用两大数据类型：（）、（）。

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