A、Schematic B、PCB C、FPGA D、VHDL
A、通过系统仿真,可以得知所设计系统在功能,延时等方面是否满足设计要求,并为系统的修改,优化提供依据 B、时序仿真是对综合后的网表进行的仿真,只验证设计模块的基本逻辑功能 C、功能仿真需要利用FPGA 芯片布局布线后的信息 D、ModelSim 不支持VHDL 和VerilogHDL 的混合仿真
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