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【简答题】

若JK触发器初态为0，试根据图中CP、J、K端波形画出Q，Q的波形。<img src="https://nimg.ppkao.com/2018-08/chenfang/201808241510403925.jpg?sign=c2f9d0de151194c55835ab1ddffd53ac&t=62d45889" />

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第1题

[简答题] 题60图（a）所示时序逻辑电路，试作出各个触发器的Q的波形。（各触发器初态为0）

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第2题

[简答题] 由负边沿JK触发器组成的电路及其CP、J端输入波形如图所示，试画出Q端的波形（设初态为“0”）。

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第3题

[简答题] 电路如图4.26所示： (1) 图示电路中采用什么触发方式； (2) 分析下图所示时序逻辑电路，并指出其逻辑功能； (3) 设触发器初态为0，画出在CP脉冲下Q0和Q1的波形。

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第4题

[简答题] 如图各触发器，可设其初态为Q=0或Q=1。试分别画出各电路对应4个CP脉冲作用下的输出端Q的波形。

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第5题

[简答题] 由维阻D触发器和边沿JK触发器组成的电路如图（a）所示，各输入端波形如图（b）。当各触发器的初态为“0”时，试画出Q1和Q2端的波形，并说明此电路的功能。

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第6题

[简答题] 试画出下列触发器的输出波形（设触发器的初态为0）。 1. 2. 3.

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第7题

[单选题] 主从JK触发器（）

A、CP=1，主触发器翻转或保持原态 B、CP=1，从触发器翻转或保持原态 C、CP=0，主触发器翻转或保持原态

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第8题

[填空题] 在时钟脉冲控制下，JK触发器输入端J=0、K=0时，触发器状态为（）；J=1、K=0时，触发器状态为（）；J=l、K=1时，触发器状态随CP脉冲的到来而（）。

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第9题

[] 时序逻辑电路通常由（）和（）两部分组成。

A、电路如图4.26所示：
(1) 图示电路中采用什么触发方式；
(2) 分析下图所示时序逻辑电路，并指出其逻辑功能；
(3) 设触发器初态为0，画出在CP脉冲下Q₀和Q₁的波形。

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