搜题

【简答题】

采用JK触发器设计一个可控同步二进制码计数器：当控制信号X=0时，实现模6加法计数；当控制信号X=1时，实现模7减法计数器，要求：<br /> （1）列出状态转换表；<br /> （2）求出各JK触发器驱动方程。（不画逻辑电路图）

查看正确答案

更多“ 采用JK触发器设计一个可控同步二进制码计数器：当控制信号X=0时，实现模6加法计数；当控制信号X=1时，实现模7减法计数器，要求：<br /> （1）列出状态转换表；<br /> （2）求出各JK触发器驱动方程。（不画逻辑电路图）”相关的问题

第1题

[简答题] 试用JK触发器设计一个同步五进制加法计数器，要求电路能够自启动。

点击查看答案

第2题

[] 寄存器中，一个触发器可以存放（）位二进制代码，要存放n位二进制代码，就要有（）个触发器。

点击查看答案

第3题

[填空题] 一个触发器可以构成（）位二进制计数器，它有（）种工作状态，若需要表示n位二进制数，则需要（）个触发器。

点击查看答案

第4题

[] 构成同步二进制计数器一般应选用的触发器是（）。

A、A.D触发器 B、B.R-S触发器 C、C.J-K触发器 D、D.T触发器

点击查看答案

第5题

[简答题] 试用JK触发器和门电路设计一个十三进制的计数器，并检查设计的电路能否自启动。

点击查看答案

第6题

[单选题] 4个边沿JK触发器，可以存储（）位二进制数。

A、4 B、8 C、16

点击查看答案

第7题

[填空题] 触发器有（）个稳态，存储8位二进制信息要（）个触发器。

点击查看答案

第8题

[判断题] 二进制异步加计数器若用上升沿触发的D触发器组成，则应将低位触发器的端与相邻高一位触发器的时钟信号CP相连。

点击查看答案

第9题

[判断题] 二进制异步加计数器若用下降沿触发的D触发器组成，则应将低位触发器的端与相邻高一位触发器的时钟信号CP相连。

点击查看答案

账号：登录

TOP

请使用微信扫码支付

订单号：
遇到问题请联系在线客服