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【简答题】

异步复位怎样用VHDL语言描述？

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第1题

[] CLK信号怎样用VHDL语言描述？

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第2题

[简答题] 用VHDL设计一个功能类似74LS160（异步复位和同步使能加载的十进制加法计数器）的计数器。

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第3题

[简答题] 给出含有异步清0和计数使能的16位二进制加减可控计数器的VHDL描述。

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第4题

[简答题] 与软件描述语言相比，VHDL有什么特点？

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第5题

[单选题] 在C语言的基础上演化而来的硬件描述语言是（）

A、VHDL B、Verilog HDL C、AHD D、CUPL

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第6题

[简答题] 试描述一个异步复位、二十进制的减法计数器，写出FPGA程序。

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第7题

[单选题] 下列硬件描述语言中，QuartusⅡ不支持的是（）

A、VHDL B、SystemC C、AHDL D、VerilogHDL

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第8题

[简答题] 用同步时序电路对串行二进制输入进行奇偶校验，每检测5位输入，输出一个结果。当5位输入中1的数目为奇数时，在最后一位的时刻输出1。（同步复位）（异步复位）

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第9题

[填空题] VHDL的结构体用来描述设计实体的（）或（），它由VHDL语句构成，是外界看不到的部分。

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