在图所示的逻辑电路中，试画出Q1和Q2端的波形，时钟脉冲的波形CP如图所示。设初始状态Q1=Q2=0。<img src="https://nimg.ppkao.com/2018-08/chenfang/2018082415252640458.jpg?sign=4888fa3bc2e75c15446323f11e8ecabf&t=62d1e874" />

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第1题

[] 根据图所示的逻辑图及相应的CP、RD和D的波形，试画出Q1端和Q2端的输出波形，设初始状态Q1=Q2=0。

A、根据图所示的逻辑图及相应的CP、R<sub>Dsub>和D的波形，试画出Q<sub>1sub>端和Q<sub>2sub>端的输出波形，设初始状态Q<sub>1sub>=Q<sub>2sub>=0。

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第2题

[] 在图所示TTL门电路中，已知门电路输出的高电平UOH=3V，输出的低电平UOL=0.3V，输入A、B、C的波形如图（b）所示，试画出Y的波形图。

A、在图所示TTL门电路中，已知门电路输出的高电平U<sub>OHsub>=3V，输出的低电平U<sub>OLsub>=0.3V，输入A、B、C的波形如图（b）所示，试画出Y的波形图。

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第3题

[简答题] 在下图所示的主从JK触发器电路中，CLK和A的电压波形如图中所示，试画出Q端对应的电压波形。设触发器的初始状态为Q=0。

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第4题

[简答题] 在下图所示电路中，若CLK、S、R的电压波形如图中所示，试画出Q和Q′与之对应的电压波形。假定触发器的初始状态为Q=0。

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第5题

[] 集成十进制计数器74LS160逻辑符号如图，Q3为最高位，Q0为最低位。试用两片74LS160构成100进制计数器，在已有的符号图上画出电路连线图。（74LS160功能表如下图所示）。

A、集成十进制计数器74LS160逻辑符号如图，Q<sub>3sub>为最高位，Q<sub>0sub>为最低位。试用两片74LS160构成100进制计数器，在已有的符号图上画出电路连线图。（74LS160功能表如下图所示）。

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第6题

[] 时序逻辑电路通常由（）和（）两部分组成。

A、电路如图4.26所示：
(1) 图示电路中采用什么触发方式；
(2) 分析下图所示时序逻辑电路，并指出其逻辑功能；
(3) 设触发器初态为0，画出在CP脉冲下Q<sub>0sub>和Q<sub>1sub>的波形。

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第7题

[简答题] 在图P5.6（a）所示电路中，已知输入电压uI的波形如图（b）所示，当t＝0时uO＝0。试画出输出电压uO的波形。

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第8题

[] 在下图所示的电路中，L=0.8uH，C1=C2=20pF，Rs=10kΩ，RL=5kΩ，Q0=100。试求回路在有载情况下的谐振频率f0，谐振电阻RΣ，回路有载Q值和通频带BW0.7。

A、在下图所示的电路中，L=0.8uH，C<sub>1sub>=C<sub>2sub>=20pF，R<sub>ssub>=10kΩ，R<sub>Lsub>=5kΩ，Q<sub>0sub>=100。试求回路在有载情况下的谐振频率f<sub>0sub>，谐振电阻R<sub>Σsub>，回路有载Q值和通频带BW<sub>0.7sub>。